DesignWare PHY IP PCI Express 2.0 
5.0Gbpsで動作するDesignWare PCI Express® 2.0 PHY IPは、データセンター、ストレージ、ネットワーキング・インフラストラクチャの各アプリケーションにおける帯域幅の拡大とインターコネクト・リンク削減への要求に対応します。このIPは、PCIe 2.0仕様やPIPE仕様に準拠しており、既存の機器との相互接続性を維持しながら性能と消費電力を最適化できます。このIPは、ジッタ、マージン、受信感度といった性能の部分ではPCI Expressの電気的仕様を超えた性能を発揮するため、性能を犠牲にせずに堅牢なデザインが可能です。また、先進のビルトイン診断機能とATEテストベクタにより、高価なテスターを使用せずに、インテグレーションの容易さと高い製造歩留まりを実現できます。

 PCI Express IPの大手プロバイダであるシノプシスは、IP業界唯一のシリコン実証済みの完全なPCI Express 2.0向けIPソリューションを提供しています。シノプシスのPCI Express向けIPソリューションには、デジタル・コントローラIP、PHY IP、検証用IPが用意されており、シノプシス1社から調達するIPだけでトータルなソリューションが完成します。1社だけですべてのIPに対応しているため、高性能なSoCデザインに5.0GbpsのPCI Expressインターフェイスを統合する際のリスクとコストを抑えられます。

  DesignWare IP PCI Express 2.0 PHYのデータシート
DesignWare IP 完全なPCI Expressソリューションのデータシート
 

DesignWare IP for PCI Express 2.0 Complete Solution Demo
See a live demonstration of the 45-nm DesignWare PHY and controller IP for PCI Express® 2.0 operating in a single-lane configuration at 5 GT/s. The demonstration verifies 5 GT/s operation using the PCI® Tree software and executes Reads and Writes between the demo hardware and a PC to show throughput performance levels.

Scott Knowlton
Sr. Product Marketing Manager

 

  • データ転送速度を2.5Gbpsから5.0Gbpsに向上
  • PCI Express 2.0（5.0Gbps）と1.1（2.5Gbps）仕様に準拠
  • PCI Express 1.1との下方互換性
  • Root Complex、Endpoint、Dual Mode、Switchの各アプリケーションへの統合を想定した設計
  • マージンと受信感度の部分ではPCI Expressの電気的仕様を超えており、堅牢なデザインが可能
  • 独自のビルトイン診断機能により、リンク性能の可視性を向上成
  • ATE（Automatic Test Equipment）テストベクタにより、完全なat-speed量産テストが可能
  • デジタル・コントローラIP、PHY IP、検証用IPを包括的に提供する完全なPCI Express 2.0 IPソリューション
  • 先進の65nmプロセス技術をサポート。40nmプロセス技術へのロードマップを提
PCIe PHY, CP 65G, x4 - FCSTARsSubscribe
PCIe PHY, CP 65G, x8 - FCSTARsSubscribe

 

  説明 PCIe PHY, CP 65G, x4 - FC
  名称 dwc_pcie2phy-fc-cp65g-x4
  バージョン 1.1f
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  製品の種類 インプリメンテーションIP
  ドキュメント
  ダウンロード dwc_pcie2phy-fc-cp65g-x4
  
  説明 PCIe PHY, CP 65G, x8 - FC
  名称 dwc_pcie2phy-fc-cp65g-x8
  バージョン 1.1f
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  ダウンロード dwc_pcie2phy-fc-cp65g-x8