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概要

今日の最先端デザイン、特に90nm以降の設計に取り組む今日の設計者にとって、タイミング・クロージャは常に最重要課題です。設計者が迅速にタイミング・クロージャを実現するためには、高精度にモデリングすることによって実シリコンでの動作を予測可能にできる信頼性の高いタイミング・サインオフ・ソリューションが必要です。

PrimeTimeのソリューション

シノプシスのスタティックタイミング解析ソリューション PrimeTimeは高い信頼性と最先端の機能を備えたゲートレベル・デザイン向けタイミング・サインオフ・ソリューションです。ゲートレベル対応のスタティックタイミング解析ツールとしてデファクト・スタンダードの地位を確立したPrimeTimeは、Galaxyデザイン・プラットフォームを構成する重要な製品のひとつでもあります。

幅広いサインオフ解析機能を備えたPrimeTime STAソリューションは、タイミング・サインオフのための総合的かつ優れた実行環境を提供することによって、タイミング解析とサインオフを実行するための業界共通の尺度としての役割を担ってきました。PrimeTime STAは、包括的なタイミング解析チェック、高度な解析テクニック、ゴールデン・ディレイ・カリキュレーター、高度なモデリング、高速な処理速度と容易な操作性、優れたグラフィカル・ユーザー・インターフェイス、業界を網羅するASICベンダ・サインオフ認定とファウンドリサポートなどの多くの利点を設計者に提供します。

PrimeTimeツール・ファミリー

高い信頼性に裏付けされたスタティックタイミング解析ソリューションであるPrimeTimeは、サインオフ解析のための一連の拡張機能を実行するための基礎と環境を提供します。PrimeTimeツール・ファミリーは、シグナルインテグリティを解析するPrimeTime SI、リークパワーならびにダイナミック・パワーを解析するPrimeTime PX、バリエーションを考慮した解析を実行するPrimeTime VXなど、様々な拡張機能を提供します。

図1：Galaxyサインオフ・ソリューション

PrimeTimeの特長

●包括的なタイミング解析機能

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セットアップ/ホールド/リカバリ/リムーバル・チェック

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データ間タイミング・チェック

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クロック・ゲーティングのセットアップとホールド・チェック

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無変更チェック

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バスの競合とフローティング・チェック

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最大トランジション・チェック

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最小パルス幅チェック

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最大ファンアウトとキャパシタンス・チェック

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ユーザー定義の最大 / 最小遅延のチェック

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入力/出力遅延、入力トランジション、ポート・ドライブ・セル、出力ロード設定のサポート

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マルチクロック設定のサポート

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マルチサイクルとフォルスパス例外設定のサポート

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トランスペアレント・ラッチとタイム・ボローイング機能のサポート

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クロック生成/分配のサポート

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クロックレイテンシ、クロックスキュー、クロック不確実性のサポート

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パルスクロック設定のサポート

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ケース解析機能

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モード解析機能

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タイミングチェック解析のカバレッジレポート機能

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寄生遅延、SDF遅延のアノテーション

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ユーザー定義遅延とトランジションのアノテーション

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広範囲にわたるデザイン/制約条件/アノテーション/遅延レポート機能

●高度な解析テクニック

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オンチップ・バリエーション（OCV）解析

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高度なオンチップ・バリエーション・モデリング（AOCVM）解析

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悲観性を排除したクロック再収束

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レジスタごとのマルチクロック設定

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自動フォルスパス検出

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動的フィードバックループの切断

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ワースト到着スルー伝播

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パスを指定した再計算と解析

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ボトルネック解析

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What-if ECO解析

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ECOネットリスト編集

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グローバル、およびインスタンス単位のタイミング・ディレーティング

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グローバル、およびネット単位のタイミング・ディレーティング

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インスタンス位置（x,y）座標をSPEFから取得

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排他的および非同期クロックのグループ化

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タイミング例外の最適化

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ユーザー定義操作条件（PVT）

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PrimeTime SIによるシグナルインテグリティ解析

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PrimeTime PXによるダイナミック/リーク・パワー解析

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PrimeTime VXによるバリエーションを考慮した解析

図2：PrimeTimeツール群

●ゴールデン・ディレイ・カリキュレーター

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寄生容量情報を使用して正確な配線解析を行うRC遅延計算機能を内蔵

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サポートするファイル形式：SPEF、DSPF、RSPF

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SBPF（Synopsys Binary Parasitic Format）サポート

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CCSとNLDM両方のLibertyライブラリをサポート

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SDF出力とカスタムSDFマッピング

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SPICEデック出力

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ワースト到着スルー伝播

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多電源デザインのサポート

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インスタンス単位の電源ライン電圧

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グローバル、およびネット単位の寄生容量スケーリング

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ライブラリ間での電圧スケーリング

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ライブラリ間での温度スケーリング

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ライブラリ単位の遅延とスルー・スレッショルド

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ピン単位の遅延とスルー・スレッショルド

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広範囲にわたる遅延計算/寄生アノテーション・レポート機能

●高度なモデリング

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Interface Logic Model（ILM）を使用した階層的スタティックタイミング解析とサインオフ

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Extracted Timing Model（ETM）（.lib 形式）を使用したセルベース・
リユーザブルIPとフィジカル設計フロー

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Quick Timing Model（QTM）を使用したトップダウン設計

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自動化されたモデル検証

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ETMデバッギング

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ETMモデルの結合

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階層化ブロック・スコープ解析

高速な処理性能と容易な操作性

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1億ゲートのフルチップタイミング解析にも対応する64ビット・アーキテクチャ

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インクリメンタル・タイミングエンジン

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保存と再読み込み機能

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インテリジェントなレポート統合機能を有する分散型マルチシナリオ解析

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What-if ECO解析

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例外と制約条件解析を考慮したデバッギング

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UPF（Unified Power Format）のサポート

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コマンドライン編集が可能なTclシェル

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Tclのサポート（コレクション、スクリプト作成など）

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gzipフォーマットで圧縮されたファイルから直接読み出し/書き込み

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幅広いレポート作成オプション

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カスタムレポート/スクリプト作成をサポートする多様な組込み属性値

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ユーザー定義属性

グラフィカル・ユーザー・インターフェイス

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スキーム、ヒストグラム、テーブル、ツリーグラフによるデザイン視覚化環境での
タイミング解析

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フル階層の回路図表示

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タイミングパスの回路図、テーブル、プロファイラの表示

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クロックネットワークの回路図とテーブルの表示

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クロックドメインの相互作用マトリックス・テーブル

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タイミングボトルネックの認識と視覚化

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パス再計算テーブル

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設計属性テーブル

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スラックおよび設計データヒストグラム

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カスタム化可能なヒストグラム

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Tclシェルから起動

ASICベンダ・サインオフとファウンドリサポート

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Chartered Semiconductor Manufacturing

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富士通株式会社

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IBM

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LSI Logic

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NECエレクトロニクス株式会社

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株式会社ルネサステクノロジ

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Samsung

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STMicroelectronics

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Texas Instruments

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株式会社東芝

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TSMC

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UMC

入力/出力形式

ネットリスト：Verilog、VHDL、Synopsys DDC形式

制約条件：PrimeTime制約条件、SDC、UPF

寄生および遅延：SPEF、DSPF、RSPF、SBPF、SDF

ライブラリ：CCSおよびNLDM（シノプシスdb形式）